锁相环频率锁定后存在很大相位差导致控制电压很大纹波

srj915 · 发表于 2024-7-29 20:01:56

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如图，锁相环采用的是环振结构，具体仿真结果如下图，是需要从哪方面着手考虑？CP mismatch和漏电吗？谢谢

srj915 · 发表于 2024-7-29 20:07:19

CP结构

srj915 · 发表于 2024-7-29 20:08:42

已经跑过PFD➕CP 的死区，没问题

143800 · 发表于 2024-7-30 14:35:45

修改一下 cp的电容电阻值

jamesccp · 发表于 2024-7-30 15:45:54

还在稳定过程？1mS后看看有没有差异？

nanke · 发表于 2024-7-31 11:23:12

（1） 450mV是不是有点低，下面的nmos能饱和吗？（2）看看是相位差导致的还是开关注入和时钟馈通导致的，如果是相位差需要减小icp电流，其它的忘了，可以看下书上怎么说的。如果kvco非常小，7mV影响也很小。

srj915 · 发表于 2024-7-31 11:28:29

nanke 发表于 2024-7-31 11:23
（1） 450mV是不是有点低，下面的nmos能饱和吗？（2）看看是相位差导致的还是开关注入和时钟馈通导致的，如 ...

电源电压是1.1V，设定的vco中间频率的时候VC是550mV。把LP F的RC替换成理想的RC，跑出来的Vc纹波就很小，只有uV级了

srj915 · 发表于 2024-7-31 11:30:07

jamesccp 发表于 2024-7-30 15:45
还在稳定过程？1mS后看看有没有差异？

感觉已经锁定了，相位差没有变小的趋势，我把LPF的RC替换成理想的RC就不存在这个问题

srj915 · 发表于 2024-7-31 11:31:53

143800 发表于 2024-7-30 14:35
修改一下 cp的电容电阻值

我把LPF的RC替换成理想的RC就不存在这个问题了，换成PDK里面的就不行了，滤波器不能有效去除Spur,不知道怎么解决

nanke · 发表于 2024-7-31 11:40:13

srj915 发表于 2024-7-31 11:31
我把LPF的RC替换成理想的RC就不存在这个问题了，换成PDK里面的就不行了，滤波器不能有效去除Spur,不知道 ...

那你看下你用的mos电容有没有漏电或者寄生之类的。不行就只能用mom电容或者厚栅mos了。

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