自制mom电容提问

艾白白要自信 · 发表于 2024-7-15 22:12:03

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我要用的mom电容比PDK中提供的要小，所以尝试自制一个mom电容，现在已经将版图画好，过了DRC，想知道后续该怎么做，怎么把这个电容放到我的原理图中，感谢各位大佬指教！

489315174 · 发表于 2024-7-15 22:36:03

现在你这么做只能通过抽取寄生来看对应电容大小。如果原理图中要体现。那网表里要不要也体现出来。要不要通过lvs 来验证连接是否正确。如果都需要。那么再加个识别层，或固定cell名称。修改lvs rule 来check 自定制的device

张江板砖工头 · 发表于 2024-7-15 23:31:56

Mark。

菜菜CC · 发表于 2024-7-16 02:31:53

学习一下，同样现在也在自己做小单位电容

菜菜CC · 发表于 2024-7-16 02:33:01

489315174 发表于 2024-7-15 22:36
现在你这么做只能通过抽取寄生来看对应电容大小。如果原理图中要体现。那网表里要不要也体现出来。要不要通 ...

请问这个有具体的教程么？

wer004aqqcom · 发表于 2024-7-16 07:58:48

流片的时候出现了自制的mom被foundry做坏了，in out 连起来了。DRC都过了，但是垃圾FOUNDRY就说我们提供有MOM为什么不用？

jiangnaner · 发表于 2024-7-16 09:20:24

Mark。

艾白白要自信 · 发表于 2024-7-16 11:32:28

wer004aqqcom 发表于 2024-7-16 07:58
流片的时候出现了自制的mom被foundry做坏了，in out 连起来了。DRC都过了，但是垃圾FOUNDRY就说我们提供有M ...

请教一下您的电容制作流程是什么，我现在刚给电容过完DRC，后续应该怎么做呢

菜菜CC · 发表于 2024-7-16 14:48:53

wer004aqqcom 发表于 2024-7-16 07:58
流片的时候出现了自制的mom被foundry做坏了，in out 连起来了。DRC都过了，但是垃圾FOUNDRY就说我们提供有M ...

请问前仿时候是用相同大小的理想电容来替代自制电容进行仿真吗？自制电容LVS和PEX时候是不是得加个库里的器件去跑？

艾白白要自信 · 发表于 2024-7-16 15:05:22

489315174 发表于 2024-7-15 22:36
现在你这么做只能通过抽取寄生来看对应电容大小。如果原理图中要体现。那网表里要不要也体现出来。要不要通 ...

老哥那有什么别的方法吗，我现在也有点卡住了，LVS，PEX需要网表文件，而要得到网表文件又需要LVS，在CIW中抽取的网表是空的。有什么更好的方法吗

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