问一个很基础的dc综合的时钟周期的问题

鹅鹅鹅丶 · 发表于 2024-6-4 11:02:47

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我这里创建了周期为20ns的时钟，意思不就是一个上升沿到下一个上升沿的时间为20ns嘛。
为什么我的时序报告里面这个“clock clk' (rise edge)”是10ns，这个参数不就是代表着上升沿到下一个上升沿的时间嘛？

maomao198477 · 发表于 2024-6-4 11:04:49

周期跟时钟沿是一个概念？

温柔阴影 · 发表于 2024-6-4 11:44:41

可能一个上升沿触发，一个下降沿触发

hxy2018 · 发表于 2024-6-4 13:28:11

要看下你的SDC里是怎么定义时钟的，如果是-waveform {10， 20}，那么这个是10ns是上升沿。或者是下降沿触发，上升沿采样，那么也是10ns

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