verilogaA ADC_ideal和DAC_ideal不对啊

模拟电路入门者 · 发表于 2024-5-22 14:53:47

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使用ahdlLib里的ideal adc和dac，结果不对啊，为啥呢图片_0880c4c80710d1b2ce1b.jpg

ftfight · 发表于 2024-5-22 15:58:49

你得Q一下设置参数

模拟电路入门者 · 发表于 2024-5-22 18:58:08

ftfight 发表于 2024-5-22 15:58
你得Q一下设置参数

我知道了，有一个地方写错了，然后还要注意设置trise,tfall，不能为0

[求助] verilogaA ADC_ideal和DAC_ideal不对啊