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Moonlight_66 发表于 2024-4-16 19:54 你换成analog库里理想的电容呢
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david_reg 发表于 2024-4-16 19:52 该电容是用subckt定义的, n1,n2只是subckt定义的port; 与mismatch有关的参数传递是 lr,wr,mr -> geo_fac - ...
qgbfhl 发表于 2024-4-16 22:10 奇怪的是,我明明在ade xl跑了mc,但是input.scs里并没有这个工艺角
Moonlight_66 发表于 2024-4-17 21:40 你找错input.scs了吧,你这明显是跑的Normal的网表
qgbfhl 发表于 2024-4-18 09:21 不是很懂你的意思,我只看到一个input.scs
仿真路径
Moonlight_66 发表于 2024-4-18 20:35 你可以在这个路径下看你的仿真文件
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