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楼主: feynmancgz

[原创] CMOS图像传感器专题 - 1 高动态范围(HDR)成像

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发表于 2024-6-26 16:26:00 | 显示全部楼层
楼主有周边ADC电路相关的资料推荐吗?最近在学习用于CIS的单斜DAC和两级比较器
发表于 2024-7-4 17:18:31 | 显示全部楼层
thanks!
发表于 2024-7-8 11:49:30 | 显示全部楼层
感谢楼主,对我们从业人员很有帮助!
发表于 2024-7-8 13:46:31 | 显示全部楼层
写的真不错!
发表于 2024-7-8 13:50:59 | 显示全部楼层
“Sugawa的学生,LOFIC的发明人Nana Akahane专门就有一篇文章介绍这个SNR dip降到多少是可以承受的” 能分享下这个文章的题目吗?
 楼主| 发表于 2024-7-8 16:40:27 | 显示全部楼层


cisdesign 发表于 2024-7-8 13:50
“Sugawa的学生,LOFIC的发明人Nana Akahane专门就有一篇文章介绍这个SNR dip降到多少是可以承受的” 能分 ...


Optimum Design of Conversion Gain and Full Well Capacity in CMOS Image Sensor with Lateral Overflow Integration Capacitor, 2009, IEEE Transactions on Electron Devices
发表于 2024-7-12 16:08:46 | 显示全部楼层

大牛科普,感谢!
发表于 2024-7-14 16:41:50 | 显示全部楼层
谢谢楼主,但是我不太明白,DUAL CONVERSION GAIN 和 DUAL ANALOG GAIN 之间针对 SNR dip 的差异是从哪里来的呢?
电流都是积分同样的时间,切换增益的电流位置,器件的信噪比应该没有变化,那么是因为列级 ADC 在高电压和低电压时的 SNR 不一样大吗?
DUAL ANALOG GAIN在切换增益的位置,低增益输出低电压,高增益输出高电压,如果接入同一个ADC的话,信噪比应该会有差别的吧?
请求好心人不吝赐教
发表于 2024-7-15 14:00:37 | 显示全部楼层


feynmancgz 发表于 2024-7-8 16:40
Optimum Design of Conversion Gain and Full Well Capacity in CMOS Image Sensor with Lateral Overflo ...


感谢!
发表于 2024-7-15 19:19:03 | 显示全部楼层
刚接触手机sensor这一块,看了楼主的帖子觉的受益匪浅,想请教下楼主有没有推荐的书籍啊?
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