关于dc综合后时序报告的一些疑惑

打不出空白 · 发表于 2024-1-10 13:48:24

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目前刚开始接触dc，想问下大家几个问题:

1、我想在时序报告中找到输入到输出的路径，但是综合出来从时序报告中找不到这样的路径（有我不关心的输入到输出的路径）?

2、约束改变时时序报告也会相应的改变，导致之前分析过的路径又再一次没了？
3、我该如何去找我关心的时序路径，因为设计对路径延迟要求比较高？

flyskyseu · 发表于 2024-1-10 14:04:29

跑完了之后不要exit，就可以直接report_timing你关心的路径了

flyskyseu · 发表于 2024-1-10 14:05:23

改变约束肯定会timing的

打不出空白 · 发表于 2024-1-10 14:10:50

flyskyseu 发表于 2024-1-10 14:04
跑完了之后不要exit，就可以直接report_timing你关心的路径了

在timing report报告中没有找到我想要路径是需要自己设计吗

flyskyseu · 发表于 2024-1-10 14:30:00

打不出空白发表于 2024-1-10 14:10
在timing report报告中没有找到我想要路径是需要自己设计吗

你可以在脚本里显示的report_timing你想要的路径

打不出空白 · 发表于 2024-1-10 14:36:47

flyskyseu 发表于 2024-1-10 14:30
你可以在脚本里显示的report_timing你想要的路径

嗯嗯了解了感谢！

AlvinRolling · 发表于 2024-1-11 19:54:34

1 输入到输出的路径为fully comb路径，一般的设计中是不包括这种纯组合的路径的。你需要自己了解设计中是否有该路径。
2 “约束改变” 尽在综合前修改，综合后不能再修改。
3 看一下dc手册的report相关的内容

robin0612 · 发表于 2024-2-28 17:00:56

用group_path命令将感兴趣的路径进行分组，report时会默认报出来

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