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[求助] Verilong A代码求助

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发表于 2023-11-17 19:10:10 | 显示全部楼层 |阅读模式

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请问一下这里哪个地方错误了
 楼主| 发表于 2023-11-17 19:51:30 | 显示全部楼层
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发表于 2023-11-19 09:54:53 | 显示全部楼层
输出声明与变量声明分两行,应该是这样的
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发表于 2023-11-19 10:34:26 | 显示全部楼层
鼠标放在红线处看看报错信息,这样子好调试些
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发表于 2023-11-19 10:59:55 | 显示全部楼层
错误提示是什么呢?
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 楼主| 发表于 2023-11-20 12:32:32 | 显示全部楼层


   
gogo16888 发表于 2023-11-19 10:59
错误提示是什么呢?



                               
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发表于 2023-11-20 14:06:39 | 显示全部楼层
选择菜单里面的 "View -> Parser Log File",看看哪里报错
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发表于 2023-11-20 14:51:29 | 显示全部楼层
你确定这是Verilog-A?我看来看去,这都是典型的Verilog代码啊!
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