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[求助] CIFF架构中的求和如何实现

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发表于 2023-9-24 11:26:31 | 显示全部楼层 |阅读模式

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请问CIFF SDM中的求和具体电路是什么样的?谢谢!


                               
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 楼主| 发表于 2023-9-24 11:46:58 | 显示全部楼层
发帖怎么看不到呢
发表于 2023-9-24 11:58:06 | 显示全部楼层
看几篇经典的文献就知道了。有用电容并联累加的,有用电容串联累加的(NS SAR里)。可以看看Youngcheol Chae的经典论文。
发表于 2023-9-24 12:01:02 | 显示全部楼层
比如经典的“Low Voltage, Low Power, Inverter-Based
Switched-Capacitor Delta-Sigma Modulator”里的
CIFF累加.png
 楼主| 发表于 2023-9-24 18:25:06 | 显示全部楼层


xdf666 发表于 2023-9-24 12:01
比如经典的“Low Voltage, Low Power, Inverter-Based
Switched-Capacitor Delta-Sigma Modulator”里的 ...


谢谢你提供参考论文。
以下是我的问题:


1. 在这个SDM中,前馈通路的增益,即如(a)所示,a0=0.5,a1=a2=1,a3=2,和图(c)中的电容CF1~4有什么关系,a0~3也是电容的比值吗?表达式是什么?

2. CF1~4及其相关开关是怎么实现求和的?
3. 图(c)中给出了Cs1=5pF,根据图(a)第一级积分器增益C1=0.2,则可得对应的积分电容CI1=25pF,这个电容有这么大吗?
发表于 2023-9-25 11:06:43 | 显示全部楼层
本帖最后由 hebut_wolf 于 2023-9-25 11:07 编辑


amini6 发表于 2023-9-24 18:25
谢谢你提供参考论文。
以下是我的问题:


5pF 应该是KT/C噪声受限,  如果是我设计,C1这个参数我会选择接近1,这样可以让总电容尽量小,然后调整其它参数值,让总传函不变。

 楼主| 发表于 2023-9-25 12:37:16 | 显示全部楼层


hebut_wolf 发表于 2023-9-25 11:06
5pF 应该是KT/C噪声受限,  如果是我设计,C1这个参数我会选择接近1,这样可以让总电容尽量小,然后调整其 ...


主要是这两个问题还不太清楚:

1. 在这个SDM中,前馈通路的增益,即如(a)所示,a0=0.5,a1=a2=1,a3=2,和图(c)中的电容CF1~4有什么关系,a0~3也是电容的比值吗?表达式是什么?
2. CF1~4及其相关开关是怎么实现求和的?
发表于 2023-9-25 14:02:57 | 显示全部楼层
a0=CF1/(CF1+CF2+CF3+CF4)
a1=CF2/(CF1+CF2+CF3+CF4)
a2=CF3/(CF1+CF2+CF3+CF4)
a3=CF4/(CF1+CF2+CF3+CF4)
论文中的系数fig 20.a的系数和fig 20.c 应该需要经过等比例缩放。
 楼主| 发表于 2023-9-25 16:56:52 | 显示全部楼层


hebut_wolf 发表于 2023-9-25 14:02
a0=CF1/(CF1+CF2+CF3+CF4)
a1=CF2/(CF1+CF2+CF3+CF4)
a2=CF3/(CF1+CF2+CF3+CF4)


明白了,非常感谢!
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