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查看: 1853|回复: 4

[求助] 关于LDO的输出阻抗

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发表于 2023-9-7 15:56:48 | 显示全部楼层 |阅读模式

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最近小弟在读一篇文章,里面提到输出阻抗的计算,想知道红框部分的是怎么来的,为什么NMOS和PMOS的输出管会有不同,怎么计算的?

附件上传文章供大家参考 捕获.PNG

An NMOS-LDO Regulated Switched-Capacitor DC-DC Converter with Fast-Response Adap.pdf

1.61 MB, 下载次数: 68 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2023-9-7 16:13:42 | 显示全部楼层
前面兩項rop跟CL不用管,最後一項可以用測試電壓vout除以電流I(定義往上為正)求得。
VGP=vout*A(s) ->I=gmp*VGP          ->Z=vout/I=1/{A(s)*gmp}
VGN=vout*-1*A(s)->I=-1*gmn*(VGN-vout)->Z=vout/I=1/{(1+A(s))*gmn}
发表于 2023-9-7 17:52:28 | 显示全部楼层
本帖最后由 大话天神 于 2023-9-7 17:54 编辑

设VOUT小信号变化△Vx,则VOUT=VREF+△Vx。△VGP=△Vx*A(S)。小信号电流变化△I=△VGP*gmp,交流阻抗等于△Vx/△I=△Vx/△Vx*A(S)*gmp=1/A(S)*gmp
发表于 2023-9-7 17:58:08 | 显示全部楼层
第二个同样
 楼主| 发表于 2023-9-8 09:18:46 | 显示全部楼层


bspeng 发表于 2023-9-7 16:13
前面兩項rop跟CL不用管,最後一項可以用測試電壓vout除以電流I(定義往上為正)求得。
VGP=vout*A(s) ->I=gmp ...


谢谢,我想明白了
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