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[讨论] 版图中的噪声。

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发表于 2023-8-20 16:21:47 | 显示全部楼层 |阅读模式

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各位大佬想问下,版图中哪里会有噪声,噪声一般在那些点,怎么预防呢?
发表于 2023-8-21 09:25:17 | 显示全部楼层
时钟和信号,静态动态,不干净电源地,模拟和数字,采样线之间等等等等。
发表于 2023-8-21 10:08:43 | 显示全部楼层


이지은 发表于 2023-8-21 09:25
时钟和信号,静态动态,不干净电源地,模拟和数字,采样线之间等等等等。 ...


那PLL里关心的热噪声和Flick噪声又是怎么回事呢?
发表于 2023-8-22 09:16:02 | 显示全部楼层


黄17141213013 发表于 2023-8-21 10:08
那PLL里关心的热噪声和Flick噪声又是怎么回事呢?


都说了,等等。。。。,每个产品的要求又都不一样
发表于 2023-8-23 10:17:03 | 显示全部楼层
真的不懂問版圖設計會更清楚
发表于 2023-8-25 16:03:27 | 显示全部楼层
哪里有噪声问电路designer最清楚
发表于 2023-8-28 09:56:11 | 显示全部楼层


菜鸟xx 发表于 2023-8-25 16:03
哪里有噪声问电路designer最清楚


确实
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