验证环境如何获取RTL的例化参数值（verrilog parameter）

买履人 · 发表于 2023-5-27 20:32:05

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如题，在RTL中有参数化的模块，例化时对参数进行赋值，验证环境如何获取到这个参数的值？

veryIC · 发表于 2023-5-29 09:29:20

直接层次引用就可以吧

saipolo · 发表于 2023-5-29 10:26:25

可以参考synopsys testsuite中获取参数的做法，名字类似于get_cc_constant

买履人 · 发表于 2023-5-30 22:56:01

saipolo 发表于 2023-5-29 10:26
可以参考synopsys testsuite中获取参数的做法，名字类似于get_cc_constant

老铁，testsuite在哪里可以看到

saipolo · 发表于 2023-5-31 09:13:30

买履人发表于 2023-5-30 22:56
老铁，testsuite在哪里可以看到

这要你厂花钱买的

年轻的韭菜 · 发表于 2023-5-31 18:04:32

如果有render脚本可以做前处理，否者就要想其他办法了

saipolo · 发表于 2023-6-1 19:40:10

年轻的韭菜发表于 2023-5-31 18:04
如果有render脚本可以做前处理，否者就要想其他办法了

韭菜哥技术颇为霸道

买履人 · 发表于 2023-6-2 21:00:25

saipolo 发表于 2023-5-31 09:13
这要你厂花钱买的

好吧

买履人 · 发表于 2023-6-2 21:01:49

年轻的韭菜发表于 2023-5-31 18:04
如果有render脚本可以做前处理，否者就要想其他办法了

感谢韭菜哥，我研究一下

qsh123_123 · 发表于 2023-6-5 10:46:55

拿手头上的一段代码测试了下，是可以直接引用打印出来的。

见下图，蓝绿色背景的是源代码，黑色背景的是仿真出来的log结果。
chip_clk_if是个可参数化的interface，用不同的参数实例化了2个instance实例，然后加了个initial块打印了实例化参数出来，见最下面的log文本的184行和185行，两个不同实例的参数结果都打印出来了。module的实例化也是可以通过类似方式实现获取和打印。
直接类似后门访问那样在testbench一层层hierarchy地索引进去，或者写一个bind文件bind到对应的RTL实例上打印，都是可以的。

[原创] 验证环境如何获取RTL的例化参数值（verrilog parameter）

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