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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › Setup time在Place和CTS之后的对比
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查看: 1402|回复: 5

[原创] Setup time在Place和CTS之后的对比

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发表于 2023-5-15 21:37:12 | 显示全部楼层 |阅读模式

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举例：reg2ip的检查(该设计为partition设计）



REG1（顶层的REG)---> Input port（ip端口）


（1）在顶层APR过程中，调用IP的Lib（该lib为place阶段的lib），从时序报告看到该Ip的setup为30ps
（2）在顶层APR过程中，调用IP的Lib（该lib为cts之后阶段的lib），从时序报告看到该Ip的setup为300ps

请问为何在place阶段的ip setup time < cts阶段的ip setup？
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 楼主| 发表于 2023-5-15 21:38:33 | 显示全部楼层
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maomao198477
发表于 2023-5-15 22:08:15 | 显示全部楼层
place  有buf了么？
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 楼主| 发表于 2023-5-15 23:15:39 | 显示全部楼层


maomao198477 发表于 2023-5-15 22:08
place  有buf了么？


clock tree 上没有buffer，input port端有buffer（修drv和opt插得buffer）
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王晦气
发表于 2023-5-16 14:25:59 | 显示全部楼层
setup计算和input transtion有关，有可能到IP的clock pin的transtion变大了，这个值可以查看lib具体为啥，看30p&&300ps分别对应的transition&&load table。
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 楼主| 发表于 2023-5-22 11:31:00 | 显示全部楼层


王晦气 发表于 2023-5-16 14:25
setup计算和input transtion有关，有可能到IP的clock pin的transtion变大了，这个值可以查看lib具体为啥， ...


谢谢提醒，我再去查下LIB
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