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[讨论] 生成lib库时,output端口为什么需要insert buffer?

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发表于 2023-4-26 10:03:58 | 显示全部楼层 |阅读模式

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当output端口没有buffer隔断,直接生成lib库给顶层模块使用时,会遇到一些奇怪的问题。

1 output端口为复位输出,顶层design使用该lib时,会显示该复位端口的cap非常大
2 output端口为时钟输出,顶层design使用该lib时,该端口无时钟输出

大家是否有遇到过其他问题?
有大神可以解释下对于第2种情况,为啥时钟不会送出啊?
发表于 2023-5-12 15:29:49 | 显示全部楼层
1.和你一条长net没加buffer一样; 2.时钟不应该是sdc在端口定义的吗?没定义,lib会产生?
 楼主| 发表于 2024-1-16 10:24:28 | 显示全部楼层
原因应该是clock net 同时连接到reg/CK 和output port。导致output port变成startpoint,而不是feedthrough。希望大神给个更专业的解释
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