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[招聘] 模拟电路设计(时钟PLL方向) 苏州大厂

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发表于 2023-4-25 11:30:10 | 显示全部楼层 |阅读模式

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二、岗位要求:

1)掌握PLL设计理论

2)有数字PLL,LC PLL设计经验优先

3) 有数字域建模经验优先

4) 有16nm, 10nm, 7nm, 5nm FinFet工艺经验优先

5) 熟悉NC-Verilog,VCS数字仿真工具;熟悉Spectre,ADE,AMS模拟仿真工具;






 楼主| 发表于 2023-4-28 11:02:53 | 显示全部楼层
苏州同学找我
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 楼主| 发表于 2023-5-9 16:51:36 | 显示全部楼层
光通讯找我
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发表于 2023-5-12 18:58:04 | 显示全部楼层
可以的
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