check missing via 求助

Koizon · 发表于 2023-3-23 10:38:53

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请问查找漏打的via有没有什么好方法？目前是打算通过写一个drc rule，然后通过定义net 的连接关系去check，但是现在卡在了drc rule 的编写上，不太清楚rule中哪些部分的layermap是需要的，理论上包括drc的基本配置，layermap信息，定义net连接信息，这三部分即可。

18756170293 · 发表于 2023-3-23 13:40:52

可以通过voltus 的structure analysis 中的missing via 来进行分析。

Koizon · 发表于 2023-3-23 13:47:06

18756170293 发表于 2023-3-23 13:40
可以通过voltus 的structure analysis 中的missing via 来进行分析。

这个是数字后端的工具吗，有针对layout的吗

18756170293 · 发表于 2023-3-23 13:51:35

Koizon 发表于 2023-3-23 13:47
这个是数字后端的工具吗，有针对layout的吗

virtuoso 617以上应该就有此软件，voltus-fi ，可以在launch 中查询一下。

Koizon · 发表于 2023-3-23 14:03:54

18756170293 发表于 2023-3-23 13:51
virtuoso 617以上应该就有此软件，voltus-fi ，可以在launch 中查询一下。

感谢

ljh065216 · 发表于 2023-3-24 09:13:52

写drc cmd file跑drc

Koizon · 发表于 2023-3-24 17:17:21

ljh065216 发表于 2023-3-24 09:13
写drc cmd file跑drc

对啊，现在就在写rule

jlayoutzm · 发表于 2023-12-7 09:12:21

Koizon 发表于 2023-3-24 17:17
对啊，现在就在写rule

大佬你好，请问miss via的rule有进展吗，我最近也在写，但没有很好的想法，大佬可否分享一下呢

Wesevan · 发表于 2023-12-7 09:36:36

不太理解，需要接到一起的线，跳了线没打孔的话lvs就能查出来有问题，再多余单独查一遍missing via感觉有点多余

Koizon · 发表于 2023-12-7 09:40:11

Wesevan 发表于 2023-12-7 09:36
不太理解，需要接到一起的线，跳了线没打孔的话lvs就能查出来有问题，再多余单独查一遍missing via感觉有点 ...

比如网格状的power，同一根net有很多交叠的地方需要打via，你打一处via LVS就能过，但是没有打via的地方IR DROP就不会强

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