设为首页收藏本站

eetop公众号

创芯大讲堂

创芯人才网

切换到宽版

手机号码，快捷登录

创芯云服务 : 创芯大讲堂 | 创芯人才网 | 数字IC职业培训 EETOP诚邀线上IC培训讲师!

搜帖子

EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 非常好的Verilog代码风格资料 RTL Design Style Guide f ...

1 234 / 4 页下一页

发新帖

楼主: mars2022

[资料] 非常好的Verilog代码风格资料 RTL Design Style Guide for Verilog HDL

发表于 2022-11-29 22:07:15 | 显示全部楼层

too old

回复支持反对

发表于 2022-11-30 09:34:42 | 显示全部楼层

下来看看，呵呵

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2022-12-6 09:39:20 | 显示全部楼层

thanks

回复支持反对

发表于 2022-12-7 10:48:05 | 显示全部楼层

谢谢分享！

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2022-12-7 10:54:01 | 显示全部楼层

谢谢分享

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2022-12-10 22:13:35 | 显示全部楼层

thankx

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2022-12-12 18:31:53 | 显示全部楼层

thanks

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2023-2-21 09:10:54 | 显示全部楼层

thanks

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2023-2-21 09:19:04 | 显示全部楼层

Thanks for sharing

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2023-6-23 00:53:09 | 显示全部楼层

thanks

回复支持反对

1 234 / 4 页下一页

发新帖

高级模式

B Color Image Link Quote Code Smilies

您需要登录后才可以回帖登录 | 注册

本版积分规则回帖后跳转到最后一页

关闭

站长推荐 /2

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号京公网安备:11010502037710 )

GMT+8, 2024-12-22 23:00 , Processed in 0.024655 second(s), 7 queries , Gzip On, Redis On.

eetop公众号

创芯大讲堂

创芯人才网

快速回复 返回顶部 返回列表