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[讨论] 关于车规 DFT coverage要求

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发表于 2022-10-22 23:35:05 | 显示全部楼层 |阅读模式

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我们现在准备车规芯片,要求为5 DPPM,按照98% yield换算的话,最后要求DFT coverage(dcscan)达到99.99%以上。对于这个目标,单从DFT这边达到要求,应该无法做到。

所以,想问问大家,车规项目,控制类、非控制类芯片,一般DPPM要求是多少?
DFT这边的coverage(dcscan、acscan)的要求是多少?
有什么方法可以达到99.99%以上的要求?

谢谢!!
发表于 2022-10-25 16:29:18 | 显示全部楼层
感觉coverage到98%以上想提高都好难啊
 楼主| 发表于 2022-10-25 22:46:25 | 显示全部楼层


Joey.Yu 发表于 2022-10-25 16:29
感觉coverage到98%以上想提高都好难啊


是啊。所以想问问大家怎么达到5DPPM的要求的
发表于 2022-10-27 11:38:31 来自手机 | 显示全部楼层
什么工艺,良率这么高  能达到98%
发表于 2022-10-27 13:39:19 | 显示全部楼层
full chip做到99%是可能的。99.99%实话说,难度有点大。当然也不一定,主要还是得看芯片的复杂度
发表于 2022-10-27 15:16:19 | 显示全部楼层


soc2012 发表于 2022-10-27 11:38
什么工艺,良率这么高  能达到98%


不是良率,是dft的test coverage
 楼主| 发表于 2022-10-27 23:13:32 | 显示全部楼层


John_Zhang 发表于 2022-10-27 13:39
full chip做到99%是可能的。99.99%实话说,难度有点大。当然也不一定,主要还是得看芯片的复杂度 ...


那一般车规的5DPPM要求,如何达到?是通过功能测试,手动计算上去的?
 楼主| 发表于 2022-10-27 23:14:47 | 显示全部楼层


soc2012 发表于 2022-10-27 11:38
什么工艺,良率这么高  能达到98%


T40这种成熟工艺,良率应该可以达到98%
发表于 2022-10-28 09:24:04 | 显示全部楼层
仔细分析fault点,增加测试寄存器,增加Nofault,尽管非常困难,但有公司能做到,说明并非不可能!
发表于 2022-10-28 09:48:29 | 显示全部楼层
汽车以前的标准也不高啊,98.5%就可以。过99.5%也很正常。10多年没做过汽车项目了,不知道现在是什么标准。
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