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[求助] 关于Sigma-Delta ADC仿真的疑问

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发表于 2022-10-10 13:24:21 | 显示全部楼层 |阅读模式

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最近在总结Sigma-Delta ADC输出结果的时候,有以下俩个问题:1.在相同的仿真条件下仅改变仿真器精度,发现conservative精度比moderate精度的ADC有效位数高2位左右,跑moderate的时候会有以下的warning,想问问这合理吗?
WZPVQ2_SE046_Y_IFU(ZS3P.png
2.发现改变第一级积分器采样电容大小,对调制器信噪比没有影响,按理说热噪声KT/C,不是随着采样电容增大会减小,是因为仿真的时候tran noise没有勾选,导致仿真的时候没有把热噪声包含进去?
发表于 2022-10-10 13:49:57 | 显示全部楼层
1 这是肯定的,毕竟SDM一般SNR都在100dB以上,高精度仿真自然出来的精度也就高
2 是的
发表于 2022-10-10 13:50:55 | 显示全部楼层
同疑问,顶一下!
 楼主| 发表于 2022-10-10 13:53:21 | 显示全部楼层


castrader 发表于 2022-10-10 13:49
1 这是肯定的,毕竟SDM一般SNR都在100dB以上,高精度仿真自然出来的精度也就高
2 是的 ...


谢谢回答!请问勾上transient noise可以看出不同的采样电容对信噪比的影响吗
发表于 2022-10-10 13:55:45 | 显示全部楼层


cuizih 发表于 2022-10-10 13:53
谢谢回答!请问勾上transient noise可以看出不同的采样电容对信噪比的影响吗
...


我没试过,据说仿真会相当的慢而且不稳定。

你可以尝试用手算器件噪声,然后加入到你不带器件噪声仿出来的结果的FFT中,来得到总的噪声。
 楼主| 发表于 2022-10-10 14:01:40 | 显示全部楼层


castrader 发表于 2022-10-10 13:55
我没试过,据说仿真会相当的慢而且不稳定。

你可以尝试用手算器件噪声,然后加入到你不带器件噪声仿出来 ...


感谢回答
发表于 2022-10-10 16:52:24 | 显示全部楼层
问题2,应该是有其他原因引入的噪声淹没了KT/C噪声,比如采样开关/时钟/等?
 楼主| 发表于 2022-10-10 16:59:04 | 显示全部楼层


wkp1992101 发表于 2022-10-10 16:52
问题2,应该是有其他原因引入的噪声淹没了KT/C噪声,比如采样开关/时钟/等? ...


我没有勾选transient noise,仿真的时候会包含这些噪声吗?
发表于 2022-10-10 17:31:37 | 显示全部楼层
不会,但是电路还存在其他非理想效应,比如时钟馈通,电荷注入,输入信号每一级结果精度是否没有损失?你可以把频谱图贴出来,能看到更多信息。
 楼主| 发表于 2022-10-10 19:40:41 | 显示全部楼层


wkp1992101 发表于 2022-10-10 17:31
不会,但是电路还存在其他非理想效应,比如时钟馈通,电荷注入,输入信号每一级结果精度是否没有损失?你可 ...


cb807453bfd05cb169da19c54e03623.jpg ccb265df2a2c2343b744b116ee2d606.jpg 第一个是Simulink理想模型,第二个是电路跑出来的。电路跑出来和理想模型只有一位的差距是不是不太可能。
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