锁相环锁不上，但是Vc已经平稳了

wangxiangjun · 发表于 2022-10-6 13:23:51

IC黑乎乎发表于 2022-10-6 12:54
PSS不收敛只能跑PFDCP的

跑整体锁相环你把PSS中的仿真时间设计长一些，大于你的锁定时间，然后跑PSS，看下PSS会不会收敛

px51 · 发表于 2022-10-6 20:15:34

IC黑乎乎发表于 2022-10-6 12:54
PSS不收敛只能跑PFDCP的

嗷嗷好的谢谢。我最近也在跑PLL仿真，也没有找到可以可以仿真PLL输出相噪的方法。

IC黑乎乎 · 发表于 2022-10-7 15:57:47

wangxiangjun 发表于 2022-10-6 13:23
跑整体锁相环你把PSS中的仿真时间设计长一些，大于你的锁定时间，然后跑PSS，看下PSS会不会收敛
...

谢谢！

Zj1228 · 发表于 2022-10-19 14:33:30

您好，有DN脉冲为啥不放电呢？Vtune为什么不下降呢？你找到问题了吗？会不会是因为变容管存在漏电流呢？

IC黑乎乎 · 发表于 2022-10-29 16:26:44

Zj1228 发表于 2022-10-19 14:33
您好，有DN脉冲为啥不放电呢？Vtune为什么不下降呢？你找到问题了吗？会不会是因为变容管存在漏电流呢？ ...

是的，我看了下变容管的栅极电流，是存在大电流的，理论上是不应该存在的

Zj1228 · 发表于 2022-11-3 20:47:37

一般薄氧化层的管子会有漏电流，你的漏电流大概有多大呢？那你找到解决方案了吗？

IC黑乎乎 · 发表于 2022-11-7 11:31:35

Zj1228 发表于 2022-11-3 20:47
一般薄氧化层的管子会有漏电流，你的漏电流大概有多大呢？那你找到解决方案了吗？ ...

我调小了管子的W，会好些

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