全差分运放仿真thd问题

模拟cmos · 发表于 2022-7-28 18:26:56

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我的全差分运放就是这样

通过再接一路一半的电流作为我的共模反馈点 `S_QLOP9U}MZEV$ORCSV4.png

先采用理想共模负反馈

检测输出两者的差再与vref=3v放大提供给Vcmc

现在问题就出现在我仿真输入共模范围为1.2~2.4左右，输出共模为3v，我跑thd时接成这种结构前面100K后面10K

输出共模点3V，输入端为1.5 但是到达运放的输入端就变成（3+1.5)/ (10/11)=2.8一下子就不饱和了，然后失真就不对了，我想问一下这应该怎么接

zjouu · 发表于 2022-7-29 17:31:52

咋计算的输入2.8V？

模拟cmos · 发表于 2022-7-30 17:30:36

zjouu 发表于 2022-7-29 17:31
咋计算的输入2.8V？

比如我接这样

输入 1.5共模输出3v共模取r1 =100k r2 = 10k 那么输入vin =1.5+(3-1.5)/(10/11)~=2.8V左右然后我看了一下我下面运放输入管就是2.8左右了我想能不能运放两个输入管嵌在共模范围内

zjouu · 发表于 2022-8-1 10:07:07

你实际搭出来看看吧

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