模拟版图和数字版图的整合过程

liaohero · 发表于 2022-6-14 09:33:25

您是不是要把實現數字後與類比整合起來?

郑伟 · 发表于 2022-6-14 09:58:26

liaohero 发表于 2022-6-14 09:33
您是不是要把實現數字後與類比整合起來?

就是数模混合电路

jake · 发表于 2022-6-14 11:07:55

icc 导出网表，Virtuoso VerilogIn 将网表转成 schematic view。
icc 导出gds, Virtuoso StreamIn 将gds转成 layout view。

liaohero · 发表于 2022-6-14 13:12:56

那因該是類比ok 後整合數字。數字route 後轉gds 整合後做verfication

郑伟 · 发表于 2022-6-15 09:09:11

jake 发表于 2022-6-14 11:07
icc 导出网表，Virtuoso VerilogIn 将网表转成 schematic view。
icc 导出gds, Virtuoso StreamIn 将gds转 ...

大神，那模拟电路输出来的osc振荡信号，可以直接被数字电路使用吗，还是得通过什么转换呀

jake · 发表于 2022-6-15 12:10:24

郑伟发表于 2022-6-14 19:09
大神，那模拟电路输出来的osc振荡信号，可以直接被数字电路使用吗，还是得通过什么转换呀
...

加个大buffer，增加驱动。
如果电平不一致，加level shifter，再加大buffer。

ZMOS · 发表于 2022-6-15 12:49:43

Starspark 发表于 2022-5-28 11:33
1、首先需要用ICC生成gds文件以及版图网表文件；
2、需要用calibre工具对gds文件进行merge，否则直接导入ca ...

tf需要合并不

郑伟 · 发表于 2022-6-23 11:10:49

DemoYe 发表于 2022-5-30 17:23
Stream In的时候点上这个就可以了啊

您好，我stream in好像和您不一样，您能教我一下怎么填吗，我填完，有一个警告，然后也没出来其他东西，我进virtuoso里面也没找到读入的版图

DemoYe · 发表于 2022-6-23 11:49:01

郑伟发表于 2022-6-23 11:10
您好，我stream in好像和您不一样，您能教我一下怎么填吗，我填完，有一个警告，然后也没出来其他东西， ...

Library那一行填你导进去的库名字，不是填pdk名字

郑伟 · 发表于 2022-6-23 13:54:47

DemoYe 发表于 2022-6-23 11:49
Library那一行填你导进去的库名字，不是填pdk名字

大神，那怎么关联pdk呢，我还有pdk画的模拟电路，我刚才导进去了，但里面的layer名字和pdk的不是一个，是还有别的东西要填吧

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