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[求助] innovus DRC

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发表于 2022-3-28 12:32:39 | 显示全部楼层 |阅读模式

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(1)在innovus中 route之后,addfiller之前利用命令verify_drc检查的时候没有vio(图一),可是利用命令verify_drc  -ckeck_only all的时候就会报出很多vio(图二)
L6{TB@(YZ$WUOV7YEI0O3F1.png ~N0IVV{Y144RW8$`01%PEGW.png
short都是M1层的 ,每一个器件与vdd和vss连接处都有vio提醒,近五万个,这是咋回事啊?

这个问题让我焦虑好几天了!
 楼主| 发表于 2022-3-28 12:54:38 | 显示全部楼层
求求大牛  指导一下孩子吧  孩子快被逼疯了
发表于 2022-3-28 13:18:16 | 显示全部楼层
从贴图看 sroute 给的电源,地 net 名是 vdd!, gnd!
标准元的电源,地名字通常是 VDD, VSS
脚本中应该有类似这样两句
globalNetConnect gnd! -pin VSS -type pgpin -all
globalNetConnect vdd! -pin VDD -type pgpin -all

 楼主| 发表于 2022-3-28 13:30:09 | 显示全部楼层


jake 发表于 2022-3-28 13:18
从贴图看 sroute 给的电源,地 net 名是 vdd!, gnd!
标准元的电源,地名字通常是 VDD, VSS
脚本中应该有 ...


首先感谢大佬回复 。

在lef库中 是电源和地  是 vdd!和 gnd! (见图一图二,gnd!)
X5YEOFOF})ZY7ET20QW`M51.png SQ$CWD`TA3DCDAFLN]QE(6Y.png
(2)然后在initial_step中定义电源和地的名字
5@L5QTHX4~(52K]J46WQUBL.png
(3)在脚本中有下面四句  
3WV2CYJ$W1K7EV}KO{3}%MQ.png
K55[Z3EYC(Q0PQ{79MW785B.png

请大牛看看  这应该没啥问题吧

X5YEOFOF})ZY7ET20QW`M51.png
3WV2CYJ$W1K7EV}KO{3}%MQ.png
发表于 2022-3-28 13:47:39 | 显示全部楼层


qq1656313299 发表于 2022-3-27 23:30
首先感谢大佬回复 。

在lef库中 是电源和地  是 vdd!和 gnd! (见图一图二,gnd!)


去掉
globalNetConnect vdd! -type tiehi
globalNetConnect gnd! -type tielo
试试看

发表于 2022-3-28 13:50:57 | 显示全部楼层
从图2看,addFiller 并没有成功,还是有大量 gap。
感觉是 addFiller 造成了大量 DRC
 楼主| 发表于 2022-3-28 13:57:40 | 显示全部楼层


jake 发表于 2022-3-28 13:50
从图2看,addFiller 并没有成功,还是有大量 gap。
感觉是 addFiller 造成了大量 DRC  ...


此时并未加filler,应为库里只有decap和feedcap,没有filler,要加filler的话 还得再找IO库添加进去。所以我并addfiller

 楼主| 发表于 2022-3-28 13:58:33 | 显示全部楼层


jake 发表于 2022-3-28 13:47
去掉
globalNetConnect vdd! -type tiehi
globalNetConnect gnd! -type tielo


我待会 马上试一下

发表于 2022-3-28 15:37:12 | 显示全部楼层
加了filler之后再试试呢?会不会是井接触的问题?n井p井现在都是断开的
 楼主| 发表于 2022-3-28 15:51:53 | 显示全部楼层


lzqxiang 发表于 2022-3-28 15:37
加了filler之后再试试呢?会不会是井接触的问题?n井p井现在都是断开的


库里我找了 没有filler 只有IOfiller,下面是库里有关physical cell的东西,在添加welltap 和endcap的时候我并未添加 ,因为并不知道需不需要加这两种cap。工艺是XFAB .35工艺。 QVS](1Q5QOO}4XGBUFWB9SN.png

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