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[讨论] datapath 上的与门是怎样处理竞争冒险的?

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发表于 2022-1-6 20:48:29 | 显示全部楼层 |阅读模式

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datapath 上的与门不可避免地会产生竞争冒险现象,进而产生毛刺,那前端和后端有必要处理这种 case 吗?
发表于 2022-1-6 22:49:12 | 显示全部楼层
用高速信号gating慢速信号
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 楼主| 发表于 2022-2-6 20:45:44 | 显示全部楼层


   
ljcfcb 发表于 2022-1-6 22:49
用高速信号gating慢速信号


都是signal,怎么区分快速和慢速信号?
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发表于 2022-2-10 14:06:31 | 显示全部楼层
你都说了是datapath了,即使产生毛刺有什么关系呢?clock path上的毛刺才需要检查
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发表于 2022-2-26 14:50:31 | 显示全部楼层


   
wenfangsibao 发表于 2022-2-6 20:45
都是signal,怎么区分快速和慢速信号?


奈奎斯特采样
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 楼主| 发表于 2022-3-15 11:59:40 | 显示全部楼层


   
杰克淡定 发表于 2022-2-10 14:06
你都说了是datapath了,即使产生毛刺有什么关系呢?clock path上的毛刺才需要检查 ...


data path 上的毛刺传递到寄存器的data pin上,假如此时正好clock 上升沿到来,那不会出问题吗?
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发表于 2022-3-16 19:20:27 | 显示全部楼层


   
wenfangsibao 发表于 2022-3-15 11:59
data path 上的毛刺传递到寄存器的data pin上,假如此时正好clock 上升沿到来,那不会出问题吗?
...


同步时钟域下,clock不会采到data上的毛刺,如果采到了,说明电路的setup和hold时序不满足
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 楼主| 发表于 2022-5-9 01:01:27 | 显示全部楼层


   
杰克淡定 发表于 2022-3-16 19:20
同步时钟域下,clock不会采到data上的毛刺,如果采到了,说明电路的setup和hold时序不满足
...


可否详细讲解一下,谢谢
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发表于 2022-12-2 13:32:05 | 显示全部楼层
同步电路里面的采样只有一个时钟沿,除了jitter和skew上的concern之外,最重要的就是setup
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发表于 2022-12-2 13:32:55 | 显示全部楼层


   
ljcfcb 发表于 2022-12-2 13:32
同步电路里面的采样只有一个时钟沿,除了jitter和skew上的concern之外,最重要的就是setup ...


还有hold time,这两个timing window把产生glitch的可能性都排除在外。

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