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[原创] DDR 控制器的设计

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发表于 2021-11-17 22:42:45 | 显示全部楼层 |阅读模式

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  在DDR的控制器的设计中,最开始面临的挑战是效率的优化,即如何在给定的恶劣条件下能够做大效率的最大化。在引入了QOS以后,latency也是一个很大的挑战,需要保证关键命令的执行速度。所以好的控制器要做大效率最优的同时,也可以很好的处理QOS,尽快处理高优先级的命令,还需要小心的设计防饥饿的机制保证命令不会在队列中等待太久。也需要及时和验证组的同事沟通,搭建QOS的仿真和评估环境。
  LPDDR5新引入的CAS命令和WCK逻辑的控制也都是不小的挑战。
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