DRAM传输数据时的功耗

Aden_zhang · 发表于 2021-10-20 11:33:07

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昨天网上看资料的时候看到有个博主说DRAM传输0更加耗电，想不明白这是为什么。
GDDR5协议里在讲DBI的时候判断逻辑确实是直接判断数据中0的数量，这和我在D2D中看到的不一样，在D2D中DBI会通过比较当前数据和上一个数据来判断是否使用DBI功能，以此来减少信号传输时的翻转，因此我觉得这位博主说的可能是对的，但是我没有证据！
有大佬能帮忙解答嘛？下面是GDDR5中关于DBI的图例，万分感谢！！！

Aden_zhang · 发表于 2021-10-20 11:33:58

自己顶自己一下

gubels · 发表于 2021-10-20 13:36:07

nice info. Tnx..

dqwuf2008 · 发表于 2021-10-20 13:45:14

D2D是啥玩意？

Aden_zhang · 发表于 2021-10-20 13:58:38

dqwuf2008 发表于 2021-10-20 13:45
D2D是啥玩意？

芯片里面的一种通信方式啦，在存储器之间直接进行数据交互

y23angchen · 发表于 2021-10-20 14:19:27

这个是由IO特性来决定的，D4是 0消耗更多的功耗， LP4 是 1 消耗更多的功耗, 在DBI功能开启后，会当8bit中 “0” or“1”个数大于4 后进行整体数据的反转。

Aden_zhang · 发表于 2021-10-20 18:21:58

y23angchen 发表于 2021-10-20 14:19
这个是由IO特性来决定的，D4是 0消耗更多的功耗， LP4 是 1 消耗更多的功耗, 在DBI功能开启后，会当8bit中 ...

好的哦，谢谢大佬！！！
我查了GDDR5和LPDDR4关于DBI的部分，虽然不知道到底是什么样的I/O特性决定的，但是一个用DBI_n,一个用DBI应该也能说明问题了，谢谢解惑

jungswee · 发表于 2021-10-22 09:53:19

Aden_zhang 发表于 2021-10-20 18:21
好的哦，谢谢大佬！！！
我查了GDDR5和LPDDR4关于DBI的部分，虽然不知道到底是什么样的I/O特性决定的，但 ...

DDR4 接收时终端电阻是上拉的。驱动端传输0的时候下拉，有电流；而驱动端传输1的时候上拉，没有电流，所以省电；GDDR和LPDDR道理类似，只是IO上下拉属性不一样。

Aden_zhang · 发表于 2021-10-22 13:59:06

jungswee 发表于 2021-10-22 09:53
DDR4 接收时终端电阻是上拉的。驱动端传输0的时候下拉，有电流；而驱动端传输1的时候上拉，没有电流，所 ...

这下完全明白了，谢谢大佬答疑解惑！！！

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