求助，LVS不过，如图，这是什么原因

九漏鱼 · 发表于 2021-9-17 16:00:59

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spartan313 · 发表于 2021-9-17 16:16:04

bulk 没接好？

maomao198477 · 发表于 2021-9-17 16:16:10

这是没有连对造成的：）

九漏鱼 · 发表于 2021-9-17 16:26:34

maomao198477 发表于 2021-9-17 16:16
这是没有连对造成的：）

这个是数字的PR里包含了一个模拟的EPHY模块，我上一版是过了的，这一版没有改连线，只是模拟的部分改了EPHY里面的东西改了，为什么会连错了呢

九漏鱼 · 发表于 2021-9-17 16:28:17

geo24 发表于 2021-9-17 16:16
bulk 没接好？

这个是数字的design，里面有个大IP，是模拟那边做的，他们改了里面的东西，但是对我这部分应该没什么影响才对，我没有改数字的PR啊，为什么会出现这个问题呢

spartan313 · 发表于 2021-9-17 18:55:24

看看是不是有sub 没包起来看看layer 层

九漏鱼 · 发表于 2021-9-18 16:14:08

geo24 发表于 2021-9-17 18:55
看看是不是有sub 没包起来看看layer 层

是的，已经解决了，是因为数字模块与模拟模块接的sub不同导致的，十分感谢

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