IC设计电路后仿CALIBRE参数提取问题

月半明时 · 发表于 2021-9-16 09:59:03

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求助;目前提取的电路寄生参数会短接器件源漏端。怎么解决.

月半明时 · 发表于 2021-9-16 10:06:45

有人吗？？？

lemon乐飞 · 发表于 2021-9-16 10:49:11

短接主要是DNW的器件吧，是器件位置的原因，如果DNW端反标回去的线角度刚好和DNW到SUB端角度一样，就会short，在calibreview的setup界面Device Placement勾选Arrayed，可以避免，但最好还是检查一下

lemon乐飞 · 发表于 2021-9-16 10:54:39

calibreview反标回去短路主要是DNW器件吧，是因为器件位置的原因，反标回去的时候当DNW端的线角度刚好和DNW端到SUB端的角度一样时，就会出现DNW端和SUB端short，在calibreview的setup界面Device Placement勾选Arrayed就可以解决，但最好还是再检查一下

lemon乐飞 · 发表于 2021-9-16 10:55:29

这个

月半明时 · 发表于 2021-9-16 13:59:50

lemon乐飞发表于 2021-9-16 10:55
这个

您好，是这个问题吗？

月半明时 · 发表于 2021-9-16 14:08:43

lemon乐飞发表于 2021-9-16 10:55
这个

还是存在这个问题，而且这个寄生电阻的阻值明显偏大，有3欧了

月半明时 · 发表于 2021-9-16 14:18:56

月半明时发表于 2021-9-16 14:08
还是存在这个问题，而且这个寄生电阻的阻值明显偏大，有3欧了

第一次遇到这种问题，头疼。

lemon乐飞 · 发表于 2021-9-16 15:58:52

应该看看版图DNW的电位是否正确，还有Device Placement最好勾选Arrayed哦，勾选layout loacation我有遇到DNW管子反标回去的时侯DNW端和SUB端short的情况

月半明时 · 发表于 2021-9-16 17:11:17

lemon乐飞发表于 2021-9-16 15:58
应该看看版图DNW的电位是否正确，还有Device Placement最好勾选Arrayed哦，勾选layout loacation我有遇到DN ...

是有这种错误，但是这个错误应该和B、T短接无关，而且B、T短接错误已经改掉，并且错误不是一个器件上的。

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