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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout资料区 › PLL的设计和Layout报告
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楼主: windyxqy

[资料] PLL的设计和Layout报告

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iTaogo
发表于 2021-12-1 13:48:42 | 显示全部楼层
不要误导人,这个资料没啥价值,学生的作业差不多
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gubels
发表于 2021-12-4 02:48:04 | 显示全部楼层
Tnx fo saring
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omnik
发表于 2021-12-4 08:36:55 | 显示全部楼层
gooooooooooooood
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carl11223344
发表于 2021-12-11 15:56:54 | 显示全部楼层
Homework level data...
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青线
发表于 2022-1-5 16:27:44 | 显示全部楼层
谢谢分享
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825555056
发表于 2022-2-22 21:18:36 | 显示全部楼层
这版图画的好
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jeffej
发表于 2022-2-23 14:46:56 | 显示全部楼层
very good for pll layout
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cipsa
发表于 2022-3-28 09:24:56 | 显示全部楼层
謝謝分享。
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lpt520
发表于 2022-11-25 12:38:03 | 显示全部楼层
谢谢
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pxt406249621
发表于 2022-12-29 16:27:34 | 显示全部楼层
很好，下次不要再分享了
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