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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › VNW VPW对formality的影响
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查看: 2010|回复: 2

[求助] VNW VPW对formality的影响

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ic小新
发表于 2021-5-27 10:46:06 | 显示全部楼层 |阅读模式
15资产
image.jpg
如上图所示，最近在做formality的时候，verify失败的点全是跟VNW, VPW相关的，请问这种应该怎么处理？
VNW, VPW不应该是电源么，怎么在这里认成了BBPin？
谢谢
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ic小新
 楼主| 发表于 2022-7-9 10:24:08 | 显示全部楼层
搞定，忽略拉倒
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ic小新
 楼主| 发表于 2022-7-9 10:25:01 | 显示全部楼层
忽略即可
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