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[求助] ADC中动态比较器offset如何仿真的问题

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发表于 2021-5-24 17:27:28 | 显示全部楼层 |阅读模式

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看到一些帖子的教程说的是,输入ramp信号,看输出翻转点。但是我的比较器是只在每个CLK信号的上升沿才会比较,就是说一个周期只会比较一次,这样的话就不能看出翻转点了。请问各位大佬,是我的哪个流程有问题呢?还是仿真方法不对?正确的仿真方法是什么样的呢?
下图是我比较器的波形图和电路图:
P1`D2ONA)3GM93DT651S2.png

比较器波形图

比较器波形图

在输入差分信号大于0后,比较器输出没有变化

发表于 2021-5-24 17:43:31 | 显示全部楼层
最简单的方法就是输入斜坡信号,后面加一个理想比较器和D触发器,看D触发器的输出。论坛有资料,自己找找吧。
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发表于 2021-5-24 19:13:43 | 显示全部楼层
ramp信号要足够长,保证ramp上升的过程里能够经历许多个比较器时钟周期。
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 楼主| 发表于 2021-5-24 21:05:34 | 显示全部楼层


   
老尤皮 发表于 2021-5-24 19:13
ramp信号要足够长,保证ramp上升的过程里能够经历许多个比较器时钟周期。


我跑了多个周期,只是这样要怎么看offset呢,我的波形里,输入过零点处,时钟信号=0,处于准备阶段,之后输出为1也是因为时钟信号=1。
如果时钟信号周期变了,输出跳变点也在变,不是offset啊
%DRG_D(J%LPTT))S06%N1[W.png


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发表于 2021-5-25 01:15:00 | 显示全部楼层
你输入一个足够足够慢上升的ramp信号,慢到你的比较器比较时间内输入信号的变化幅度对于你的offset的大小来说可以忽略不计。
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发表于 2021-5-25 19:03:35 | 显示全部楼层


   
sqxu1103 发表于 2021-5-24 21:05
我跑了多个周期,只是这样要怎么看offset呢,我的波形里,输入过零点处,时钟信号=0,处于准备阶段,之后 ...


在你的这个图上,竖线的位置,输入信号是6.23mV,比较器输出高电平
前一次比较的位置,你没有标出来,我假设前一次比较的位置,输入信号是-6.23mV,比较器输出低电平
输入-6.23mV能够比出来是低电平,输入+6.23mV能够比出来是高电平,说明你的比较器offset的区间是(-6.23mV,6.23mV)
接下来,更改你的ramp信号的电压范围,再进行仿真,就能够进一步缩小你的比较器的offset的范围。
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发表于 2023-4-25 15:27:30 | 显示全部楼层
谢谢
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