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基于标准单元库的深亚微米数字集成电路的自动化设计流程。此流程从
设计的系统行为级描述或RTL 级描述开始,依次通过系统行为级的功能验证,设计综合,
综合后仿真,自动化布局布线,到最后的版图后仿真。在这里,我们用Synopsys 公司的
VSS(VHDL System Simulator)工具进行各种仿真,用Design Compiler 进行综合,用Cadence
公司的Silicon Ensemble 进行自动布局布线。对于最后的版图后仿真,由于输出文件的限
制,我们改用Active-HDL 工具进行验证。本文同时用一个实例DDFS 对整个流程加以了举例说明。
[ 本帖最后由 MOSFET 于 2007-12-14 20:12 编辑 ] |
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