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[求助] uvm lab 1.1 的lab1遇到问题求解

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发表于 2021-4-11 14:27:21 | 显示全部楼层 |阅读模式

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为啥会一直出现图片里的错误啊?一直照着实验书写的,有大佬解答下吗?

 楼主| 发表于 2021-4-11 14:32:11 | 显示全部楼层
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 楼主| 发表于 2021-4-11 14:41:33 | 显示全部楼层
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 楼主| 发表于 2021-4-11 15:08:34 | 显示全部楼层
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发表于 2021-4-11 19:11:55 | 显示全部楼层
图片呢
 楼主| 发表于 2021-4-11 22:44:05 | 显示全部楼层


不好意思刚刚给我改没了
Snipaste_2021-04-11_14-24-55.png
发表于 2021-4-12 19:28:08 | 显示全部楼层
seq_item_port和seq_item_export是你自己定义的吗?
 楼主| 发表于 2021-4-13 08:51:45 | 显示全部楼层


gaurson 发表于 2021-4-12 19:28
seq_item_port和seq_item_export是你自己定义的吗?


这两个端口是uvm中自带的端口
发表于 2021-4-13 17:34:28 | 显示全部楼层
如果方便,把input_agent的43行前后的代码截图发来看看。
 楼主| 发表于 2021-4-13 20:25:27 | 显示全部楼层


gaurson 发表于 2021-4-13 17:34
如果方便,把input_agent的43行前后的代码截图发来看看。


刚刚解决了,谢谢啦


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