为什么设计中多为上升沿采样？

周志鹏 · 发表于 2021-3-22 20:59:09

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在AHB协议中，仲裁器采样都是上升沿采样，只知道下降沿不行，但不知道为什么谢谢看到的人帮忙解答谢谢！

viviy · 发表于 2021-3-22 21:41:29

这个因设计习惯而已。
你如果去看spi里面，正沿采样负沿驱动，正沿驱动负沿采样。都是有的啊。

A1985 · 发表于 2021-3-22 21:47:18

理论上 rising transition 特性好

myee · 发表于 2021-3-23 10:29:29

A1985 发表于 2021-3-22 21:47
理论上 rising transition 特性好

因为N型管比P型管打开快？

周志鹏 · 发表于 2021-3-23 11:21:22

为什么 rising transition特性好呀？选用上升沿采样还有别的原因吗？

fhy420462303 · 发表于 2021-3-23 11:37:55

理论上上升沿的transition 比较好！

frj8848 · 发表于 2021-3-23 14:26:19

猜测和PLL设计相关，很多PLL保证周期不保证占空比（50%），一些std cell的clk driver也是优化的上升沿。个人意见，等大神。

ICS · 发表于 2021-3-24 10:32:21

这也是我一直困惑的问题。

周志鹏 · 发表于 2021-3-24 11:37:28

我后来问了同事他们也说到占空比的事。（不知道对不对，仅供参考）
就是时钟的上升沿的时间是确定的，什么时候电平由低变高但是设计中会遇到占空比不是50%,或者其它比例的情况，这样的话处于高电平下降的时间就是不确定的，也就是下降沿什么时候下降不确定那么这个时候如果用下降沿采样就不能准确把握具体下降时间。

yex · 发表于 2021-3-24 14:39:17

其实无论上升沿或者下降沿都是可以的，但是同事一般都建议使用上升沿设计，我觉得这个主要是设计习惯的问题吧

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