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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC测试与可测性 › 讨论区 › tessent mbist电路中，TAP CLK period相关问题
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查看: 6008|回复: 19

[求助] tessent mbist电路中，TAP CLK period相关问题

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YouHKH
发表于 2021-3-19 23:26:41 | 显示全部楼层 |阅读模式

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本帖最后由 YouHKH 于 2021-3-19 23:32 编辑

用 tessent shell insert mbist回路，在TAP protocal中，为什么TCK period一定要是BIST CLK period的4倍？
有什么原因吗？谁能帮忙解释一下。

※下面这个 是LV flow的guide，实际tessent shell也有同样的问题。
image.png



Memory的测试频率是20MHz的时候，TCK就只能用小于5MHz的时钟去测试？
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YouHKH
 楼主| 发表于 2021-3-19 23:28:18 | 显示全部楼层
为什么3倍，2倍不行？
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YouHKH
 楼主| 发表于 2021-3-22 00:05:27 | 显示全部楼层
自己顶一个
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fs2003tom
发表于 2021-3-22 12:30:07 | 显示全部楼层
谢谢！
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uitce2011
发表于 2021-3-22 13:17:03 | 显示全部楼层
thank you for sharing
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YouHKH
 楼主| 发表于 2021-3-23 22:49:23 | 显示全部楼层
哪位大神帮忙回答一下
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chen_well
发表于 2021-3-25 22:34:03 | 显示全部楼层
本帖最后由 chen_well 于 2021-3-25 22:35 编辑

tck在bist时钟下拍了3拍取反，和tck在bist时钟下拍了2拍，进行逻辑与操作，获得图1中tck脉冲。为了保证能够采到tck脉冲，至少bist_clk是tck的4倍。

个人愚见。
图1.png
图2.png
图3.png
图4.png

tck脉冲

tck脉冲

对ASYNC_INTERF_R_IN拍一拍

对ASYNC_INTERF_R_IN拍一拍

ASYNC_INTERF_R_IN信号来源

ASYNC_INTERF_R_IN信号来源

ASYNC_INTERF_R_IN为TCK拍了两拍

ASYNC_INTERF_R_IN为TCK拍了两拍
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YouHKH
 楼主| 发表于 2021-3-25 23:54:15 | 显示全部楼层


chen_well 发表于 2021-3-25 22:34
tck在bist时钟下拍了3拍取反，和tck在bist时钟下拍了2拍，进行逻辑与操作，获得图1中tck脉冲。为了保证能够 ...


3Q，明天去确认一下波形。
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YouHKH
 楼主| 发表于 2021-3-26 22:41:52 | 显示全部楼层


chen_well 发表于 2021-3-25 22:34
tck在bist时钟下拍了3拍取反，和tck在bist时钟下拍了2拍，进行逻辑与操作，获得图1中tck脉冲。为了保证能够 ...


感觉应该是TCK作为BIST_CLK的data pin用，如果TCK period < 4 x BIST_CLK的话，
TCK&BIST_EN之后，就不是一个全period信号，导致后面BIST_CLK FF可能踩不到正确值。


image.png

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chen_well
发表于 2021-3-29 20:32:22 | 显示全部楼层


YouHKH 发表于 2021-3-26 22:41
感觉应该是TCK作为BIST_CLK的data pin用，如果TCK period < 4 x BIST_CLK的话，
TCK&BIST_EN之后，就不是 ...


您说的这个蛮对的，我当时没考虑到bist_en
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