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[求助] PT和Innovus报的clock source latency 差很多,PT报的很大(generate clock))

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发表于 2020-10-28 16:25:32 | 显示全部楼层 |阅读模式

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image.png
如图,求助各位大神,在PT里面报的这个时钟的source latency为什么比innovus中的大那么多?这个是generate clock,它的master clock的source latency是0,
network latency是6。
发表于 2020-10-28 21:12:43 | 显示全部楼层
是同一个corner吗,另外你分别报一下到这个pin的path是不是有问题
发表于 2020-10-28 21:45:59 | 显示全部楼层
这两个tool check的是同一个level的design么?
发表于 2020-10-29 09:43:26 | 显示全部楼层
PT report 里 source 是 ICG EN pin,  这显然是不对的。
估计是 create_generated_clock 没写对。 Innovus 即使 create_generated_clock 有错(不是语法错,是逻辑错),  也能勉强接受。 PT 苛刻一些,毕竟是 signoff tool。
通常 ICG output clock 不需要加 create_generated_clock。
 楼主| 发表于 2020-10-29 10:12:49 | 显示全部楼层


jake 发表于 2020-10-29 09:43
PT report 里 source 是 ICG EN pin,  这显然是不对的。
估计是 create_generated_clock 没写对。 Innovus ...


你好,谢谢回复,这个不是generate clock的source pin,sdc里定义的generate clock没有问题。这个EN端是latch的,因为库里面没有ICG,所以自己用latch和and搭了门控时钟,工具把latch作为了一个sink点
 楼主| 发表于 2020-10-29 10:14:14 | 显示全部楼层


watertree 发表于 2020-10-28 21:45
这两个tool check的是同一个level的design么?


你好,是同一个level的
 楼主| 发表于 2020-10-29 10:29:12 | 显示全部楼层


五角大楼 发表于 2020-10-28 21:12
是同一个corner吗,另外你分别报一下到这个pin的path是不是有问题


你好,都是SS corner的, image.png 左边是PT,右边是Innovus,工具把这个latch的EN端当做了数据端,所以报了unconstrained
发表于 2020-10-29 10:56:34 | 显示全部楼层


苏格拉没有弟弟 发表于 2020-10-29 10:29
你好,都是SS corner的,左边是PT,右边是Innovus,工具把这个latch的EN端当做了数据端,所以报了unconst ...


把它展开,你就看到具体值为什么差这么大了
发表于 2020-10-29 11:14:43 | 显示全部楼层


苏格拉没有弟弟 发表于 2020-10-28 20:29
你好,都是SS corner的,左边是PT,右边是Innovus,工具把这个latch的EN端当做了数据端,所以报了unconst ...


report_timing -from tim_gen_inst/clk_adc_raw_reg/CP -to tim_gen_inst/clk_gate_clk_stg1_raw_reg/latch/EN -path_type full_clock -unconstrained
比较到 tim_gen_inst/clk_adc_raw_reg/CP 的 clock path 到底有啥不一样就可以了

 楼主| 发表于 2020-10-29 11:15:47 | 显示全部楼层


五角大楼 发表于 2020-10-29 10:56
把它展开,你就看到具体值为什么差这么大了


我看差的地方就是两种工具的source latency值不一样,PT会大很多,我不清楚PT是怎么计算出来这么大的值的
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