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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 有关全加器hpsice仿真 testbench的问题
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[求助] 有关全加器hpsice仿真 testbench的问题

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发表于 2020-10-9 19:24:01 | 显示全部楼层 |阅读模式

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在分析一个单元的功耗时，我看到论文里边都提到了testbench这么一个东西，就是在输入端增加buffer，输出端添加电容的方法。 请问在哪些地方可以看到这些testbench作用的介绍呢？  或者哪位老哥能帮忙解释一下使用这些testbench的作用。？
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