跟06届师兄学数字IC/FPGA设计

asic_service · 发表于 2020-9-4 16:10:57

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授课理念：
verilog只是语言，表达的是“思想”（硬件俗称Architecture）。
就像你懂汉语，但是你能写出李白/杜莆那种激情豪迈的诗吗，能写出朱自清的《背影》吗，或是能做个文章在报刊杂志发表吗？
IC设计也是一样。
但是语言能教，思想很难教授。但是可以带你领略，带你欣赏。下面的课，就是以此为目标：带你领略数字IC前端设计的风景。

好不好，看疗效。
数字IC/FPGA设计入门(2期已经累计服务超110位小伙伴， 1/2课免费)：

数字IC设计入门

On-Chip-Bus精讲： (理解ddr, cache行为；认识AHB hready；AXI cmd outstanding, data out-of-order；Bus效率分析与提升；efficiency与latency的平衡，全覆盖)

On-Chip-Bus

详细目录见下：
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数字IC/FPGA设计入门目录：
第一部分：数字电路原理：
CMOS晶体管原理（试听）；基本电路单元原理；常用组合逻辑电路结构（MUX；加/减法器；乘法器；除法器）；SRAM结构与控制；
第二部分：可综合verilog数字电路设计基础：
数字前端设计流程与工具介绍；可综合Verilog语言；Verilog组合逻辑设计（MUX；译码器；加/减法器；乘法器；除法器）；时序逻辑设计（状态机设计）；generate使用；参数化IP设计介绍；基于Verilog的TestPattern编写；
第三部分：数字电路仿真工具介绍：
Modelsim仿真工具使用介绍；VCS仿真工具使用介绍；Debussy/Verdi调试工具介绍；nLint/Leda代码检查工具介绍；
第四部分：跨时钟域电路设计：
跨时钟域电路原理；基本同步电路结构；异步fifo设计与分析；
第五部分：系统总线介绍：
APB总线介绍；AHB总线介绍；AXI总线介绍；一个AXI Bus系统介绍（地址寻址与数据访问；
第六部分：IP设计范例：
仲裁器设计；AXI Master设计（支持多个command并发）；图像采集接口设计；图像高斯滤波器设计；

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第二章：数字芯片前端设计：

第一部分：静态时序分析基础：
cell library介绍与电路延时的计算方法；时钟树介绍；寄存器setup/hold介绍；静态时序分析基础介绍；
第二部分：DC综合工具使用:
DC综合流程；DC下SDC时序约束编写；TCL脚本语言简介；DC综合环境建立；DC综合脚本范例讲解；
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On-Chip-Bus精讲：
1：DDR行为介绍
2：Cache行为介绍
3：On-Chip总线数据传输原理
4：APB总线介绍
5：AHB总线介绍
6：AXI总线介绍
7：AHB/AXI总线对比
8：Bus-Arbiter/Bus-Matrix/Bus-NOC介绍
9：AXI总线效率提升
10：其它片上总线