ｖ２ｌｖｓ　进行ＬＶＳ

管叫兽 · 发表于 2020-7-4 09:42:51

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这是跑ＬＶＳ出现的错误

然后比对网表与ｖ２ｌｖｓ生成的．ｓｐｉ文件发现　，生成的该个模块ＤＦＣＬＲＢＸ１少了一个ＱＢ
请问这个我应该如何修改？

管叫兽 · 发表于 2020-7-4 11:30:20

补充一下 QB是一个悬空引脚

nanke · 发表于 2020-7-4 13:34:28

选hieratchy或flatten试试？

ivybingyueabo · 发表于 2020-7-7 13:39:00

我认为和QB 没关系。

ioll · 发表于 2020-7-16 00:15:30

求助，碰到同样的问题，问题解决了吗？能解答下吗？

管叫兽 · 发表于 2020-7-16 09:29:13

ioll 发表于 2020-7-16 00:15
求助，碰到同样的问题，问题解决了吗？能解答下吗？

还没有呢

ZHZIC · 发表于 2020-11-8 23:24:56

楼主现在解决了吗

wyg8871 · 发表于 2020-11-9 10:02:55

在转好的cdl文件里面，加上std cell的cdl文件，就好了，里面定义了std cell的pin信息。这样就可以对应上了

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