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查看: 2894|回复: 6

[求助] 请教一个PT修时序，同时有9T和7T的cell的问题

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snakkewang
发表于 2020-3-25 11:46:58 | 显示全部楼层 |阅读模式

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各位大神好，请教一个问题。 有个项目同时使用了9T和7T的cell，在DC里面我们使用了sub_target来综合，指定A只使用9T的cell。
现在进了PT修时序，发现PT没有这指定一个module只能用9T的这种命令（和DC不同）。
请问大家PT里面如何实现这个效果 ?有这方面的经验么？请指教，谢谢。
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fangwang85
发表于 2020-3-26 10:27:10 | 显示全部楼层
遇到过混用的，直接pt里面加入对应的lib库就好了，因为不同track 的cell名字不一样，所以不会出现错误
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snakkewang
 楼主| 发表于 2020-3-26 15:17:05 | 显示全部楼层
主要是fix_eco_timing会混
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王晦气
发表于 2020-4-1 17:28:24 | 显示全部楼层


snakkewang 发表于 2020-3-26 15:17
主要是fix_eco_timing会混


用physical_aware修可以吗？因为读def/lef有row信息，会不会就不会放错位置了？
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rexue5495
发表于 2020-4-2 09:05:25 | 显示全部楼层
将不要修的全部dont touch，指定库去修要做eco的
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caesarzheng
发表于 2020-4-2 09:45:27 | 显示全部楼层
你好，解决了吗？怎么解决的？
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quanqiutong
发表于 2020-4-2 10:14:16 | 显示全部楼层
用dc吃进去，分层吐出verilog，替换7T到9T或将9T换成7T，两个文件再合并就解决了，很简单的
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