问一个混合路径约束问题

memcad · 发表于 2019-11-16 18:34:29

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IA到ODQ是组合路径
OQ到ODQ是时序路径。
实际设计IA和OQ的CLK无时序关系。

当我把IA到ODQ用set_max_delay约束时，PT自动会把IA认为是由OQ的CLK相关的，导致时序violation。
大家有好的解决办法吗？

jake · 发表于 2019-11-17 00:39:38

set_max_delay -from IA -through MUX/A -to ODQ
OR
set_max_delay -combinational_from_to -from IA -through MUX/A -to ODQ

fangwang85 · 发表于 2019-12-31 21:57:53

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