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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 模数混合仿真 spectreverilog报错
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查看: 1749|回复: 4

[求助] 模数混合仿真 spectreverilog报错

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liuke1
发表于 2019-11-1 13:30:10 | 显示全部楼层 |阅读模式
150资产
本帖最后由 liuke1 于 2019-11-5 20:37 编辑


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liuke1
 楼主| 发表于 2019-11-1 14:01:01 | 显示全部楼层
帮帮忙啊

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liuke1
 楼主| 发表于 2019-11-3 14:18:09 | 显示全部楼层
没有大佬能回答一下吗？
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a56142304
发表于 2019-11-27 10:11:21 | 显示全部楼层
最后不是写内存不足嘛
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liuke1
 楼主| 发表于 2019-11-28 13:12:34 | 显示全部楼层


a56142304 发表于 2019-11-27 10:11
最后不是写内存不足嘛


问题已解决，是代码的问题
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