DRC错误 LUP.6&LUP.2

兔子先森 · 发表于 2019-10-17 10:26:24

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萌新小白第一次做模拟电路，在快要流片之前才注意到这两个与latch up相关的错误
看了网站上基本都是说加一圈guard ring就会解决，但是我已经给每个模块都画上了，最后外面也包了两圈，可是还是有部分管子报错
请问各位大牛，还有什么方法可以解决吗？

a18346182703 · 发表于 2019-10-17 13:50:20

pmos nmos器件，四周至少有一边在33um范围内，要见到相对应的衬底接触，虽然你放guard ring 了,但是放的太远了或者太少了。

兔子先森 · 发表于 2019-10-17 15:23:48

问题解决了，可能是软件问题，整块版图搬到第一象限就好了

Wesevan · 发表于 2023-2-2 09:47:06

兔子先森发表于 2019-10-17 15:23
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这为啥呀，

MrHlayout · 发表于 2023-2-2 15:35:16

兔子先森发表于 2019-10-17 15:23
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跟这个竟然还有关系？

Wesevan · 发表于 2023-2-7 14:33:30

如果是放到第一象限问题就解决了，可以检查一下DRC rule

happy_star · 发表于 2023-2-7 16:01:55

兔子先森发表于 2019-10-17 15:23
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还有这事儿？

ic初学菜鸡 · 发表于 2023-6-6 22:35:19

兔子先森发表于 2019-10-17 15:23
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LUP.2咋解决的楼主

lgs4903483 · 发表于 7 小时前

ic初学菜鸡发表于 2023-6-6 22:35
LUP.2咋解决的楼主

请问你遇到的LUP.2 怎么解决的？

[求助] DRC错误 LUP.6&LUP.2