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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 大牛 钟文枫的SystemVerilog与功能验证
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楼主: wac123

[资料] 大牛 钟文枫的SystemVerilog与功能验证

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azlkk6318
发表于 2019-8-4 20:55:16 | 显示全部楼层
thank!
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cddl
发表于 2019-8-5 12:08:31 | 显示全部楼层
谢谢分享
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Ralphjh
发表于 2019-8-6 14:24:07 | 显示全部楼层
谢谢分享
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nuerhachidetian
发表于 2019-8-8 09:03:17 | 显示全部楼层


SystemVerilog与功能验证.pdf
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零魂
发表于 2019-8-8 17:21:38 | 显示全部楼层
之前用过一阵SV 后来离开芯片行业就没用过了 现在重新捡起来
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eiownlee
发表于 2019-10-22 13:28:25 | 显示全部楼层
谢谢分享
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枪迷
发表于 2020-7-21 02:22:51 | 显示全部楼层
感谢楼主分享！
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出尘入世
发表于 2020-7-26 14:07:56 | 显示全部楼层
Thanks
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褚洪佳
发表于 2020-8-1 21:29:23 | 显示全部楼层
好东西，下载学习
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areslee
发表于 2020-8-4 17:51:56 | 显示全部楼层
收了！
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