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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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whitedogg
发表于 2024-8-5 17:03:43 | 显示全部楼层
学习一下
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o7yyyyy
发表于 2024-8-9 13:49:10 | 显示全部楼层
感谢
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htc1003
发表于 2024-8-9 14:15:06 | 显示全部楼层
谢谢
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nomercy
发表于 2024-8-9 16:27:39 | 显示全部楼层
学一下
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BRUNOS
发表于 2024-8-11 15:51:01 | 显示全部楼层
谢谢分享
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沙河粉
发表于 2024-8-11 16:14:34 | 显示全部楼层
谢谢分享
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manish12
发表于 2024-8-11 18:46:43 | 显示全部楼层
thanks for sharing
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grandcloud
发表于 2024-8-12 08:50:47 | 显示全部楼层
Thanks
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huikong2013
发表于 2024-8-12 14:09:59 | 显示全部楼层
支持
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hongshui
发表于 2024-8-12 14:21:39 | 显示全部楼层
看看
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