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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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夏悠
发表于 2023-8-21 17:32:05 | 显示全部楼层
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发表于 2023-8-23 19:35:13 | 显示全部楼层
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发表于 2023-8-24 14:17:20 | 显示全部楼层
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haitaox
发表于 2023-8-25 14:15:22 | 显示全部楼层
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ivypku
发表于 2023-8-25 15:50:00 | 显示全部楼层
谢谢
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伪界
发表于 2023-8-25 15:58:13 | 显示全部楼层
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发表于 2023-8-25 17:56:59 | 显示全部楼层
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发表于 2023-8-28 15:16:11 | 显示全部楼层
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发表于 2023-8-30 11:25:57 | 显示全部楼层
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发表于 2023-8-30 13:03:16 | 显示全部楼层
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