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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2019-1-24 09:01:00 | 显示全部楼层
谢谢！
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发表于 2019-1-24 10:40:37 | 显示全部楼层
看看
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发表于 2019-1-26 17:53:42 | 显示全部楼层
学习学习
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发表于 2019-1-26 20:58:30 | 显示全部楼层
回复 1# yoof2000


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发表于 2019-1-27 11:06:52 | 显示全部楼层
谢谢楼主！谢谢楼主
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pwy122
发表于 2019-1-30 08:58:49 | 显示全部楼层
回复 1# yoof2000
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发表于 2019-1-30 09:02:09 | 显示全部楼层
testbench的模板？
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yuhupo
发表于 2019-1-30 09:05:26 | 显示全部楼层
谢谢分享
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发表于 2019-1-30 18:54:26 | 显示全部楼层
多谢分享，学习一下！
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发表于 2019-1-31 13:35:44 | 显示全部楼层
谢谢分享！
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