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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2022-12-16 22:28:21 | 显示全部楼层
求分享
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liyirui
发表于 2022-12-18 01:25:52 | 显示全部楼层
谢谢
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发表于 2022-12-21 08:09:04 | 显示全部楼层
공유 감사
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mos-sun
发表于 2022-12-21 08:23:55 | 显示全部楼层
kankan
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fgx127
发表于 2022-12-22 10:46:49 | 显示全部楼层
支持
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shenao
发表于 2022-12-25 00:00:40 | 显示全部楼层
学习一下
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发表于 2022-12-26 16:54:01 | 显示全部楼层
看看有什么思路
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vex_005
发表于 2022-12-27 09:50:41 | 显示全部楼层
學習一下有效率的script
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WKshang
发表于 2022-12-27 14:25:37 | 显示全部楼层
看看
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发表于 2022-12-27 14:57:01 | 显示全部楼层















ooxx
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