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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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eeicer
发表于 2022-12-2 20:09:53 | 显示全部楼层
谢谢
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lc_seu
发表于 2022-12-3 09:18:23 | 显示全部楼层
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Dylanst
发表于 2022-12-5 15:02:26 | 显示全部楼层
thanks
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ustszl
发表于 2022-12-5 15:22:03 | 显示全部楼层

谢谢分享！
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发表于 2022-12-5 16:15:33 | 显示全部楼层
kanyikan
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ruanyz
发表于 2022-12-6 09:07:31 | 显示全部楼层
thanks
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发表于 2022-12-6 16:36:02 | 显示全部楼层
顶顶顶
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发表于 2022-12-11 20:30:48 | 显示全部楼层
谢谢分享
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发表于 2022-12-14 11:07:49 | 显示全部楼层
xiexi
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auschen
发表于 2022-12-16 17:26:56 | 显示全部楼层
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