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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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nukcole
发表于 2022-1-30 10:12:12 | 显示全部楼层
fffffffffffffffffffffffffffffffffffffff
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RMoney
发表于 2022-1-30 11:05:35 | 显示全部楼层
谢谢分享！
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发表于 2022-1-31 00:32:03 | 显示全部楼层
感觉不错，下载下来看看
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发表于 2022-1-31 10:10:39 | 显示全部楼层
谢谢分享！
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发表于 2022-2-1 15:00:58 | 显示全部楼层
谢谢分享！
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发表于 2022-2-2 02:37:17 | 显示全部楼层
下载学习学习，多谢楼主
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发表于 2022-2-2 04:07:41 | 显示全部楼层
thanks!
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发表于 2022-2-8 09:18:43 | 显示全部楼层
WO DE
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发表于 2022-2-9 13:50:18 | 显示全部楼层
Thanks
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发表于 2022-2-9 20:29:06 | 显示全部楼层
thanks
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